干扰检测与识别技术研究与实现

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随着无线通信技术的发展,通信环境日益复杂,干扰越来越多,干扰和抗干扰技术成为一个重要的研究领域。研究一个通信系统的抗干扰性能,首先要准确的测试出系统的干扰信号,然后才能够有效地采取抗干扰技术;电子对抗中对敌我双方的侦察与反侦察技术;认知无线电中对授权信号的识别,这都离不开干扰检测技术。本文主要研究了几种典型干扰(单音干扰、多音干扰和部分频带干扰)的检测识别技术,并联合SDR(Software Definition Radio,软件无线电)硬件开发平台和PC机,实现了干扰检测识别系统,分别在中频(Intermediate Frequency,IF)和射频(Radio Frequency,RF)条件下完成了典型干扰的检测识别性能测试,测试结果完全符合系统要求。首先,本文对能量检测基本理论进行分析,给出了能量检测的性能评估方法及其优缺点,并着重分析了两种基于频域的连续均值消除(Consecutive Mean Excision ,CME)和前向连续均值消除(Forward Consecutive Mean Excision ,FCME)干扰检测算法,在此基础上提出了一种基于子带误码率统计的干扰检测算法;其次,硬件实现了一个基于模块的干扰检测系统,并对系统中时序控制,数据速率变换,频谱叠加,频谱输出等模块设计进行了详细分析,在此基础上硬件设计并实现了一种基于静默周期干扰检测链路;最后,结合设计的干扰检测与识别界面,硬件实测了干扰检测与识别系统在中频和射频下对单音干扰、多音干扰、部分带干扰的检测与识别性能,硬件实测了系统对上面三种干扰的检测灵敏度;实测干扰检测系统在高斯白噪声、高斯白噪声和变换域通信系统(Transform Domain Communication System,TDCS)信号同时存在两种情况下对单音、多音、部分带三种干扰的检测与识别性能。硬件测试得出下面结论:中频高斯白噪声下,对于单音干扰,四个单音干扰,2.4MHz的部分带干扰( Partial-Band Interference , PBI ),当干噪比分别(Jamming-to-Noise power Ratio,JNR)大于-24.5dB,-21dB,-0.53dB时,系统检测概率大于99%;中频TDCS信号下,对于单音干扰,三个单音干扰,当干信比(Jamming-to-Signal power Ratio ,JSR)分别大于-32.2dB,-26.24dB时,系统检测概率大于99%;400MHz射频条件下,对于单音干扰,四个单音干扰,2MHz的部分带干扰,当干噪比分别大于-27.1dB,-19dB,-3.5dB时,系统检测概率逼近1;400MHz射频TDCS信号存在条件下,对于单音干扰,当JSR大于-34dB,对于2个单音干扰,当JSR大于-30dB,对于150KHMz的部分带干扰,当JSR大于-20dB,系统检测概率逼近1,优于系统要求JSR大于0dB时能够准确检测和识别出干扰的目标。
摘要第4-6页
ABSTRACT第6-7页
第一章 绪论第15-20页
    1.1 引言第15页
    1.2 课题研究背景第15-17页
    1.3 课题研究现状及发展趋势第17-19页
    1.4 本文的主要工作和组织第19-20页
第二章 干扰检测基本原理第20-38页
    2.1 干扰检测过程分析第20-26页
        2.1.1 干扰检测和识别过程第20-21页
        2.1.2 常见通信干扰的时频域分析图第21-22页
        2.1.3 典型通信干扰建模与主要参数分析第22-26页
    2.2 能量检测技术原理第26-31页
        2.2.1 能量检测的基本思想第27页
        2.2.2 能量检测的基本原理第27-28页
        2.2.3 能量检测的虚警概率和检测概率第28-31页
        2.2.4 能量检测的优缺点第31页
    2.3 基于频域的干扰检测算法研究第31-37页
        2.3.1 连续均值消除法(CME)第32-35页
        2.3.2 前向连续均值消除法(FCME)第35-36页
        2.3.3 基于子带误码率统计的干扰检测算法第36-37页
    2.4 本章小结第37-38页
第三章 干扰检测技术硬件实现第38-61页
    3.1 SFF SDR 硬件开发平台简介第38-42页
        3.1.1 SFF SDR 产品概述第38页
        3.1.2 SFF SDR 开发平台概述第38-39页
        3.1.3 SFF SDR 系统设计主要模块介绍第39-41页
        3.1.4 定点量化问题第41-42页
    3.2 20M 带宽干扰检测链路FPGA 硬件设计第42-49页
        3.2.1 数据采样与下变频子模块设计第42-43页
        3.2.2 低通滤波与加窗子模块设计第43-45页
        3.2.3 能量检测子模块设计第45-48页
        3.2.4 检测谱线输出子模块设计第48-49页
    3.3 含静默周期的干扰检测链路FPGA 硬件设计第49-53页
        3.3.1 静默期硬件设计第49-51页
        3.3.2 带静默周期的检测谱线输出硬件设计第51-53页
    3.4 DSP 与Matlab 数据交互第53-60页
        3.4.1 FPGA 与DSP 数据交互第53-54页
        3.4.2 Matlab 与干扰检测界面数据交互第54-60页
    3.5 本章小结第60-61页
第四章 干扰检测与识别性能测试第61-95页
    4.1 中频条件下的干扰检测性能测试第61-70页
        4.1.1 无信号时的扰检测性能测试第61-67页
        4.1.2 存在TDCS 信号时的干扰检测性能测试第67-70页
    4.2 射频条件下的干扰检测性能测试第70-94页
        4.2.1 400MHz 射频下的干扰性能测试第70-78页
        4.2.2 700MHz 射频下的干扰性能测试第78-84页
        4.2.3 TDCS 信号下系统射频性能测试第84-94页
    4.3 本章小结第94-95页
第五章 结束语第95-97页
    5.1 全文总结及主要贡献第95-96页
    5.2 下一步的研究工作第96-97页
致谢第97-98页
参考文献第98-101页
个人简历第101页
攻读硕士学位期间取得的成果第101-102页
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