数字微镜器件驱动平台的信号完整性设计

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集成电路规模的变大,IO引脚数目的增多,布线密度的增大,时钟频率和信号边沿速率的提高以及产品研发及市场的竞争等,这些都对产品的一次性成功提出了相当严峻的考验。在低速系统中被忽视的信号完整性问题却处处影响着高速系统的设计,因此对高速信号进行完整性分析研究已成为必然。如何在设计初期发现SI问题并找出行之有效的解决办法,对缩短研发周期及提高产品的质量都至关重要。本文首先分析了传输线理论,给出了高速信号的定义,详细阐述了信号完整性的反射、串扰、同步开关噪声以及时延的定义并给出了相应的解决方案,同时围绕具体的一个硬件平台的设计,并利用IBIS模型以及仿真软件重点针对DDR2部分高速信号进行反射、时延及串扰的建模仿真,修正并完善了原理图及高速PCB设计。
论文摘要第5-6页
ABSTRACT第6页
第一章 绪论第10-14页
    1.1 研究背景第10-11页
    1.2 信号完整性概述第11页
    1.3 国内外研究现状第11-13页
    1.4 论文的章节结构第13-14页
第二章 传输线的基本理论第14-23页
    2.1 传输线的电路模型第14-15页
    2.2 传输线方程第15-16页
    2.3 传输线的特性参数第16-17页
    2.4 PCB常用传输线第17-23页
第三章 高速数字系统的信号完整性问题第23-40页
    3.1 高速信号的定义第23-24页
    3.2 信号完整性问题第24-40页
        3.2.1 反射第24-31页
            3.2.1.1 反射的发生第24-26页
            3.2.1.2 反射导致的失真问题第26-27页
            3.2.1.3 反射问题的解决办法第27-31页
        3.2.2 串扰第31-36页
            3.2.2.1 容性串扰第32-33页
            3.2.2.2 感性串扰第33-36页
        3.2.3 同步切换噪声第36-38页
        3.2.4 时延和时序错误第38-40页
第四章 微镜芯片驱动平台的硬件设计第40-55页
    4.1 系统功能及结构框图第40-41页
    4.2 主要接口介绍第41-53页
        4.2.1 StratixⅡ的应用第41-47页
            4.2.1.1 FPGAI/O分配第42-43页
            4.2.1.2 FPGA时钟系统设计第43-45页
            4.2.1.3 FPGA配置方式第45-47页
        4.2.2 DDR2设计第47-50页
            4.2.2.1 DDR2高速接口设计第47-49页
            4.2.2.2 DDR2电源设计第49-50页
        4.2.3 视频输入输出接口第50-52页
            4.2.3.1 视频输入接口第50-51页
            4.2.3.2 视频输出接口第51-52页
        4.2.4 数字微镜芯片接口第52-53页
    4.3 电源设计第53-55页
第五章 驱动平台的SI设计第55-79页
    5.1 传统的PCB设计第55-56页
    5.2 基于SI的PCB设计第56-57页
    5.3 SI仿真模型与仿真软件第57-60页
        5.3.1 SI仿真模型简介第57-58页
            5.3.1.1 SPICE(Simulation Program with IC Emphasis)模型第57页
            5.3.1.2 IBIS(I/O Buffer Information Specification)模型第57-58页
        5.3.2 SI仿真软件简介第58-60页
            5.3.2.1 Specctraquest仿真软件第58-60页
            5.3.2.2 Hyperlynx仿真软件第60页
    5.4 硬件平台基于SI的PCB设计第60-79页
        5.4.1 平台叠层结构设计第60-62页
        5.4.2 阻抗控制第62页
        5.4.3 视频输入输出高速信号设计第62-63页
        5.4.4 DDR2高速信号设计第63-72页
        5.4.5 LVDS高速信号设计第72-74页
        5.4.6 电源与地设计第74-79页
第六章 总结与展望第79-80页
参考文献第80-83页
致谢第83-84页
攻读学位期间发表的学术论文第84页
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